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clock edge

释义

clock edge

网络时钟沿；时钟脉冲边沿；时钟缘

网络释义

1.	时钟沿亚稳定状态-学术百科-知网空间 ... 时钟域( clock domain) 时钟沿( clock edge) 时钟边界( clock boundary) ... wiki.cnki.com.cn
2.	时钟脉冲边沿专业英语-信息英语词汇(C) - 豆丁网 ... clock driver 时钟脉冲驱动器 clock edge 时钟脉冲边沿 clock frequency 时钟脉冲频率 ... www.docin.com
3.	时钟缘 ...(2)处于关闭时，则该等逻辑状态的其中另一乃会在一时钟缘(clock edge)一出现在该设定输入端处时马上被施加至该输出侧上。 patentics.com

4.	时脉缘 ...之间的逻辑状态。在各个时脉缘 (Clock edge) 中，正反器将於输入通道上锁存 1 或 0 (TRUE 或 FALSE) 数值，并维持该数值 … www.ni.com
5.	时脉边缘 ● 时脉边缘 (Clock Edge) (CKE 位元);● Baud rate (只有 Master 模式才需要); 及 ● Slave 选择模式 (只有 Slave 模式才需要)。 coopermaa2nd.blogspot.com
6.	写入操作置于频率边沿在降低峰值 RAM电源方面，可以考虑采用将读取和写入操作置于频率边沿（clock edge）的反侧，或是对RAM读/写埠上的频率 … www.eechina.com
7.	写入操作置於时脉边沿在降低峰值RAM电源方面，可以考虑采用将读取和写入操作置於时脉边沿（clock edge）的反侧，或是对RAM读/写埠上的时脉 … www.teema.org.tw

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释义:

时钟沿,时钟脉冲边沿,时钟缘

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更新时间：2025/8/5 23:09:32