英语词汇clock jitter怎么读，是什么意思，单词翻译、读音、固定搭配用法和短语词组及例句-英汉双解词典

单词

clock jitter

释义

clock jitter

简明释义

时钟抖动

网络释义

1
?时钟抖动
例如，输入时钟上的允许时钟抖动（clock jitter）就是这样一条DCM约束。在某个测试案例中，DCM在低频模式时，对周期抖动的约束为±300psec。
2
?时基抖动
16条回复-发帖时间:2005年8月20日因为Mini-DAC实在太棒了 Apogee是一家从事数字 Episode 2：什么是 时基抖动 （ Clock jitter ）在数字第六张非常有意思, 双R(RR)是一个以录音非常优秀而
3
?位时钟抖动
... 位时钟抖动(Clock Jitter) 位上升时间(Risetime ) 位下降时间(Falltime) ...

短语

1
clock jitter and dispersion
时钟抖动和漂移
2
Low clock jitter
低时钟抖动
3
Data to Clock Jitter
数据对时钟抖晃

双语例句

1
Pixel clock output frequencies range from 10mhz to 140mhz with sampling clock jitter of 250ps peak to peak.
像素时钟输出频率范围从10mhz到140mhz的采样250ps的峰峰值抖动。
2
The effect of clock jitter and phase noise on data acquisition system performance is more profound as the increase of sampling frequency and the bit of A/D converter.
随着采样频率和A/D变换器位数的增加，时钟抖动和相位噪声对数据采集系统性能的影响更加显著。
3
Based on Gaussian random process model and continuous-time system in time domain, this paper analyzes the effect on baseband and intermediate frequency sampling due to clock jitter.
该文从时域连续信号角度出发，按照高斯随机过程模型，分析了时钟抖动对基带和中频线性调频信号信噪比的影响并给出了近似公式。

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单词	clock jitter
释义	clock jitter 简明释义时钟抖动网络释义 1 ?时钟抖动例如，输入时钟上的允许时钟抖动（clock jitter）就是这样一条DCM约束。在某个测试案例中，DCM在低频模式时，对周期抖动的约束为±300psec。 2 ?时基抖动 16条回复-发帖时间:2005年8月20日因为Mini-DAC实在太棒了 Apogee是一家从事数字 Episode 2：什么是时基抖动（ Clock jitter ）在数字第六张非常有意思, 双R(RR)是一个以录音非常优秀而 3 ?位时钟抖动 ... 位时钟抖动(Clock Jitter) 位上升时间(Risetime ) 位下降时间(Falltime) ... 短语 1 clock jitter and dispersion 时钟抖动和漂移 2 Low clock jitter 低时钟抖动 3 Data to Clock Jitter 数据对时钟抖晃双语例句 1 Pixel clock output frequencies range from 10mhz to 140mhz with sampling clock jitter of 250ps peak to peak. 像素时钟输出频率范围从10mhz到140mhz的采样250ps的峰峰值抖动。 2 The effect of clock jitter and phase noise on data acquisition system performance is more profound as the increase of sampling frequency and the bit of A/D converter. 随着采样频率和A/D变换器位数的增加，时钟抖动和相位噪声对数据采集系统性能的影响更加显著。 3 Based on Gaussian random process model and continuous-time system in time domain, this paper analyzes the effect on baseband and intermediate frequency sampling due to clock jitter. 该文从时域连续信号角度出发，按照高斯随机过程模型，分析了时钟抖动对基带和中频线性调频信号信噪比的影响并给出了近似公式。
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