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单词 ADPLL
释义
ADPLL
  • 简明释义
  • abbr.全数字锁相环(all-digital phase-locked loop)
  • 网络释义
  • 1

    ?全数字锁相环

    全数字锁相环(ADPLL)是数字射频中最重要的模块之一,它不仅是发射机实现软件可配置通用调制器的基础,还是为接收机提供宽调频范围本振信号的基础。

  • 2

    ?全数字式锁相环

    关键词: 现场可编程逻辑阵列(FPGA) , 全数字式锁相环(ADPLL) , 平滑源切换 , 稳态相差 , 锁定时间 | 全部关键词

  • 3

    ?锁相环路

    因此,可以把全数字锁相环路(ADPLL)作为一个功能模..

  • 4

    ?数字锁相环

    一个新的机械化的一阶数字锁相环ADPLL)进行了讨论和分析。在循环的目的是提供连续的跟踪性高斯白噪声(WGN)的存在下,由损坏的输入波形。

短语
  • 双语例句
  • 1
    This paper discusses extraction of the bit-synchronous signal with a first-order ADPLL mainly.
    本文主要以一阶环为例讨论位同步信号提取。
  • 2
    Use a binary digital shifter replace the traditional divider in ADPLL, make the structure simple and keeps the loop gain constant when the frequency multiplication factor changes.
    采用数字移位器替代传统的除法器,使得电路结构大大简化,而且在很大的倍频系数范围内都保持很好的稳定性。
  • 3
    This paper presents a new type of all digital phase-locked loop(ADPLL)used for extracting a bit-synchronous signal to meet the requirements of the fast phase-locked in burst digital communication.
    本文根据突发式数字通信快速锁相要求,提出一种位同步信号提取的新的快速全数字锁相环方案。
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更新时间:2025/2/12 11:30:43