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单词 bus interface timing
释义
bus interface timing
  • 简明释义
  • 总线接口时序
  • 网络释义
  • 1

    ?总线接口时序

    bus interface timing 总线接口时序 mtpi multiplex timing physical interface 复用定时物理接口 positivetrainidentification(pti) 正确列车辨识 .

  • 双语例句
  • 1
    The FSM model of target PCI bus interface controller is then provided based on PCI bus operation timing.
    根据PCI总线操作时序,提出了从设备接口控制器的有限状态机模型。
  • 2
    The system utilizes CPLD to realize logical and timing control between DSP and multi-channel ADC. The interface between DSP's HPI and PCI bus is employed to achieve high-speed data transmission.
    该系统采用CPLD实现了DSP与多通道adc的逻辑和时序控制,通过DSP的HPI与PCI总线接口设计实现了采集数据的高速传输。
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更新时间:2025/1/10 11:40:41